5SGXMA7H3F35C2N Field Programmable Gate Array FBGA-1152 Stratix V GX Chip FPGA

5SGXMA7H3F35C2N Field Programmable Gate Array FBGA-1152 Stratix V GX FPGA Chips

Descrizione del prodotto 5SGXMA7H3F35C2N

I dispositivi 5SGXMA7H3F35C2N Stratix V GX offrono fino a 66 ricevitori integrati con capacità di velocità di dati di 14,1 Gbps. Questi ricevitori supportano anche applicazioni di backplane e interfaccia ottica.

5SGXMA7H3F35C2N è ottimizzato per applicazioni ad alte prestazioni e ad alta larghezza di banda come il trasporto ottico 40G/100G, l'elaborazione dei pacchetti e la gestione del traffico presenti in cablaggio,e dei mercati delle apparecchiature di prova di rete.

Specifica di 5SGXMA7H3F35C2N

Caratteristiche di 5SGXMA7H3F35C2N

Tecnologia

- Tecnologia di processo TSMC 28 nm
- tensione centrale di 0,85 V o 0,9 V

Trasmettitori seriali a bassa potenza
- trasmettitore a 28.05 Gbps su Stratix V GT
- Compensazione di dispersione elettronica (EDC) supportata da moduli ottici XFP, SFP+, QSFP, CFP
- Equalizzazione lineare adattiva e feedback sul giudizio
- Pre-enfasi e de-enfasi del trasmettitore
- Riconfigurazione dinamica del canale individuale
- Strumentazione on-chip (EyeQ non intrusivo monitoraggio oculare dati)

Capacità di backplane
- 600 megabits al secondo (Mbps) fino a 12,5 Gbps capacità di velocità di trasmissione I/O di uso generale (GPIO)

I/O di uso generale (GPIO)
- 1.6 Gbps LVDS
- 1066 MHz interfaccia di memoria esterna
- Terminazione on-chip (OCT)
- Interfaccia da 1,2 a 3,3 V per tutti i dispositivi Stratix V
Blocco di copia rigida incorporato

- PCIe Gen3, Gen2 e Gen1 full stack, terminazione x1/x2/x4/x8
IP fisso del ricevitore incorporato

- Sottolivello di codifica fisica della mezzanina (PCS)
- Gigabit Ethernet (GbE) e PCS XAUI
- 10G Ethernet PCS
- Serial RapidIO® (SRIO)
- Interfaccia radiofonica comune (CPRI) PCS
- Rete ottica passiva Gigabit (GPON) PCS

Gestione dell'energia
- Tecnologie energetiche programmabili
- Quartus II PowerPlay Power Analysis integrato

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Domande frequenti
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